湖南数字信号测试规格尺寸

对于典型的3.3V的低电压TTL(LVTTL)信号来说，判决阈值的下限是0.8V,判决阈 值的上限是2.0V。正是由于判决阈值的存在，使得数字信号相对于模拟信号来说有更高的 可靠性和抗噪声的能力。比如对于3.3V的LVTTL信号来说，当信号输出电压为0V时， 只要噪声或者干扰的幅度不超过0.8V,就不会把逻辑状态由0误判为1;同样，当信号输出  电压为3.3V时，只要噪声或者干扰的幅度不会使信号电压低于2.0V,就不会把逻辑状态  由1误判为0。

从上面的例子可以看到，数字信号抗噪声和干扰的能力是比较强的。但也需要注意，这 个“强”是相对的，如果噪声或干扰的影响使得信号的电压超出了其正常逻辑的判决区间，数字信号也仍然有可能产生错误的数据传输。在许多场合，我们对数字信号质量进行分析和 测试的基本目的就是要保证其信号电平在进行采样时满足基本的逻辑判决条件。 数字信号带宽、信道带宽、信息速率、基带、频带的带宽；湖南数字信号测试规格尺寸

建立时间和保持时间加起来的时间称为建立/保持时间窗口，是接收端对于信号保持在 同一个逻辑状态的**小的时间要求。数字信号的比特宽度如果窄于这个时间窗口就肯定无 法同时满足建立时间和保持时间的要求，所以接收端对于建立/保持时间窗口大小的要求实 际上决定了这个电路能够工作的比较高的数据速率。通常工 作速率高一些的芯片，很短的建 立时间、保持时间就可以保证电路可靠工作，而工作速率低一 些的芯片则会要求比较长的建 立时间和保持时间。

另外要注意的是， 一个数字电路能够可靠工作的比较高数据速率不仅取决于接收端对于 建立/保持时间的要求，输出端的上升时间过缓、输出幅度偏小、信号和时钟中有抖动、信号 有畸变等很多因素都会消耗信号建立/保持时间的裕量。因此一个数字电路能够达到的比较高数据传输速率与发送芯片、接收芯片以及传输路径都有关系。

建立时间和保持时间是数字电路非常重要的概念，是接收端可靠信号接收的**基本要 求，也是数字电路可靠工作的基础。可以说，大部分数字信号的测量项目如数据速率、信号 幅度、眼图、抖动等的测量都是为了间接保证信号满足接收端对建立时间和保持时间的要 求，在以后章节的论述中我们可以慢慢体会。 广东数字信号测试服务热线数字总线采用的时钟 分配方式大体上可以分为3类，即并行时钟、嵌入式时钟、前向时钟，各有各的应用领域。

数字信号并行总线与串行总线(Parallel and Serial Bus)

虽然随着技术的发展，现代的数字芯片已经集成了越来越多的功能，但是对于稍微复杂  一点的系统来说，很多时候单独一个芯片很难完成所有的工作，这就需要和其他芯片配合起  来工作。比如现在的CPU的处理能力越来越强，很多CPU内部甚至集成了显示处理的功  能，但是仍然需要配合外部的内存芯片来存储临时的数据，需要配合桥接芯片扩展硬盘、 USB等接口；现代的FPGA内部也可以集成CPU、DSP、RAM、高速收发器等，但有些  场合可能还需要配合用的DSP来进一步提高浮点处理效率，配合额外的内存芯片来扩展  存储空间，配合用的物理层芯片来扩展网口、USB等，或者需要多片FPGA互连来提高处  理能力。所有这一切，都需要用到相应的总线来实现多个数字芯片间的互连。如果我们把  各个功能芯片想象成人体的各个功能，总线就是血脉和经络，通过这些路径，各个功能  模块间才能进行有效的数据交换和协同工作。

为了提高信号在高速率、长距离情况下传输的可靠性，大部分高速的数字串行总线都会采用差分信号进行信号传输。差分信号是用一对反相的差分线进行信号传输，发送端采用差分的发送器，接收端相应采用差分的接收器。图1.13是一个差分线的传输模型及真实的差分PCB走线。

采用差分传输方式后，由于差分线对中正负信号的走线是紧密耦合在一起的，所以外界噪声对于两根信号线的影响是一样的。而在接收端，由于其接收器是把正负信号相减的结果作为逻辑判决的依据，因此即使信号线上有严重的共模噪声或者地电平的波动，对于的逻辑电平判决影响很小。相对于单端传输方式，差分传输方式的抗干扰、抗共模噪声能力 提高。 数字信号是由“0”和“1”。

数字信号的建立/保持时间(Setup/HoldTime)

不论数字信号的上升沿是陡还是缓，在信号跳变时总会有一段过渡时间处于逻辑判决阈值的上限和下限之间，从而造成逻辑的不确定状态。更糟糕的是，通常的数字信号都不只一路，可能是多路信号一起传输来一些逻辑和功能状态。这些多路信号之间由于电气特性的不完全一致以及PCB走线路径长短的不同，在到达其接收端时会存在不同的时延，时延的不同会进一步增加逻辑状态的不确定性。

由于我们感兴趣的逻辑状态通常是信号电平稳定以后的状态而不是跳变时所的状态，所以现在大部分数字电路采用同步电路，即系统中有一个统一的工作时钟对信号进行采样。如图1.5所示，虽然信号在跳变过程中可能会有不确定的逻辑状态，但是若我们只在时钟CLK的上升沿对信号进行判决采样，则得到的就是稳定的逻辑状态。 数字信号处理中的基础运算；北京数字信号测试产品介绍

抖动是数字信号，特别是高速数字信号重要的一个概念，越是高速的信号，其比特周期越短对于抖动要求就严格；湖南数字信号测试规格尺寸

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